A.512×16bit
B.256×8bit
C.256×16bit
D.1024×8bit
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你可能感興趣的試題
A.I/O指令
B.專用的數(shù)據(jù)傳送指令
C.CPU中有移位功能的數(shù)據(jù)寄存器
D.接口中的移位寄存器
A.高速緩存
B.磁盤存儲(chǔ)器
C.內(nèi)存
D.Flash存儲(chǔ)器
A.任務(wù)執(zhí)行時(shí)間
B.中斷響應(yīng)和延遲時(shí)間
C.任務(wù)切換時(shí)間
D.信號(hào)量混洗時(shí)間
A.宿主機(jī)與目標(biāo)機(jī)之間只需要建立邏輯連接
B.宿主機(jī)與目標(biāo)機(jī)之間只能采用串口通信方式
C.在宿主機(jī)上必須采用交叉編譯器來生成目標(biāo)機(jī)的可執(zhí)行代碼
D.調(diào)試器與被調(diào)試程序必須安裝在同一臺(tái)機(jī)器上
A.只能分時(shí)向總線發(fā)送數(shù)據(jù)，并只能分時(shí)從總線接收數(shù)據(jù)
B.只能分時(shí)向總線發(fā)送數(shù)據(jù)，但可同時(shí)從總線接收數(shù)據(jù)
C.可同時(shí)向總線發(fā)送數(shù)據(jù)，并同時(shí)從總線接收數(shù)據(jù)
D.可同時(shí)向總線發(fā)送數(shù)據(jù)，但只能分時(shí)從總線接收數(shù)據(jù)
最新試題
（）不屬于計(jì)算機(jī)控制器中的部件。
若內(nèi)存地址區(qū)間為4000H～43FFH，每個(gè)存儲(chǔ)單元可存儲(chǔ)16位二進(jìn)制數(shù)，該內(nèi)存區(qū)域用4片存儲(chǔ)器芯片構(gòu)成，則構(gòu)成該內(nèi)存所用的存儲(chǔ)器芯片的容量是（）
（）是指按內(nèi)容訪問的存儲(chǔ)器。
內(nèi)存按字節(jié)編址，利用8KX4bit的存儲(chǔ)器芯片構(gòu)成84000H～8FFFFH的內(nèi)存，共需（）片。
Cache用于存放主存數(shù)據(jù)的部分拷貝，主存單元地址與Cache單元地址之間的轉(zhuǎn)換工作由（）完成。
計(jì)算機(jī)系統(tǒng)中，在（）的情況下一般應(yīng)采用異步傳輸方式。
計(jì)算機(jī)執(zhí)行程序時(shí)，在一個(gè)指令周期的過程中，為了能夠從內(nèi)存中讀指令操作碼，首先是將（）的內(nèi)容送到地址總線上。
空白（1）處應(yīng)選擇（）
系統(tǒng)間進(jìn)行異步串行通信時(shí)，數(shù)據(jù)的串/并和并/串轉(zhuǎn)換一般是通過（）現(xiàn)的。
（）不是反映嵌入式實(shí)時(shí)操作系統(tǒng)實(shí)時(shí)性的評(píng)價(jià)指標(biāo)。