A.有3個(gè)500電阻構(gòu)成的分壓器
B.有兩個(gè)電壓比較器
C.有一個(gè)基本RS觸發(fā)器
D.一個(gè)驅(qū)動(dòng)器和一個(gè)放電管
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A.74LS00
B.74LS160
C.74LS164
D.74LS194
A.串行輸入，并行輸出
B.串行輸入串行輸出
C.并行輸入，并行輸出
D.并行輸入，串行輸出
A.同步計(jì)數(shù)器
B.異步計(jì)數(shù)器
C.十進(jìn)制計(jì)數(shù)器
D.二進(jìn)制計(jì)數(shù)器
A.同步計(jì)數(shù)器
B.加法計(jì)數(shù)器
C.減法計(jì)數(shù)器
D.異步計(jì)數(shù)器
A.寫方程式
B.計(jì)算并列出狀態(tài)轉(zhuǎn)換表
C.畫出狀態(tài)轉(zhuǎn)換圖或者時(shí)序圖
D.根據(jù)狀態(tài)轉(zhuǎn)換圖或時(shí)序圖說明電路的邏輯功能
最新試題
電可擦除的PROM器件是（）
DRAM4164有2根片選線（RAS和CAS）、8根地址線和1根數(shù)據(jù)線。請判斷它的存儲容量為多少？
以下代碼中為無權(quán)碼的為（）。
簡述用譯碼器或多路選擇器實(shí)現(xiàn)組合邏輯電路的不同之處。
試提出數(shù)字頻率計(jì)的三種設(shè)計(jì)方案，比較各種方案的特點(diǎn)。如果用HDPLD來實(shí)現(xiàn)，設(shè)計(jì)方案是最佳嗎？簡述理由。
判斷如下VHDL的操作是否正確，如不正確，請改正。字符a和b的數(shù)據(jù)類型是BIT，c是INTEGER，執(zhí)行c＜=a+b。
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對轉(zhuǎn)換精度的影響。
一個(gè)VHDL模塊是否必須有一個(gè)實(shí)體和一個(gè)結(jié)構(gòu)體？是否可以有多個(gè)實(shí)體和結(jié)構(gòu)體？簡述它們的作用。
如要將一個(gè)最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號，要求輸入每變化20mV，輸出信號的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
什么是觸發(fā)器的空翻現(xiàn)象，如何避免空翻？