A.8
B.16
C.128
D.256
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A.下降沿觸發(fā)
B.上升沿觸發(fā)
C.高電平觸發(fā)
D.低電平觸發(fā)
A.J=l，K=I
B.J=0，K=0
C.J=0，K=d
D.J=l，K=d
A.RS＝0
B.R＋S=I
C.RS＝l
D.R＋S=0
A.RS＝0
B.R＋S=I
C.RS＝l
D.R＋S=0
A.在CP上升沿觸發(fā)
B.在CP下降沿觸發(fā)
C.在CP＝1的穩(wěn)態(tài)下觸發(fā)
D.與CP無關(guān)的
最新試題
如要將一個最大幅度為5.1V的模擬信號轉(zhuǎn)換為數(shù)字信號，要求輸入每變化20mV，輸出信號的最低位（LSB）發(fā)生變化，應(yīng)選用（）位ADC。
與倒T形電阻網(wǎng)絡(luò)DAC相比，權(quán)電流網(wǎng)絡(luò)D/A轉(zhuǎn)換器的主要優(yōu)點(diǎn)是消除了（）對轉(zhuǎn)換精度的影響。
利用2個74LS138和1個非門，可以擴(kuò)展得到1個（）線譯碼器。
一個VHDL模塊是否必須有一個實(shí)體和一個結(jié)構(gòu)體？是否可以有多個實(shí)體和結(jié)構(gòu)體？簡述它們的作用。
一個兩輸入端的門電路，當(dāng)輸入為10時，輸出不是1的門電路為（）
如果把D觸發(fā)器的輸出Q反饋連接到輸入D，則輸出Q的脈沖波形的頻率為CP脈沖頻率f的（）。
基本RS觸發(fā)器的輸入直接控制其輸出狀態(tài)，所以它不能被稱為（）觸發(fā)器。
TTL與非門閾值電壓UT的典型值是（）
具有“有1出0、全0出1”功能的邏輯門是（）
一個16選一的數(shù)據(jù)選擇器，其地址輸入（選擇控制輸入）端有（）個。