A.交流電壓信號(hào)
B.時(shí)間和幅值上離散的信號(hào)
C.時(shí)間和幅值上連續(xù)變化的信號(hào)
D.無(wú)法確定
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A.直接置1、清0
B.直接置位、復(fù)位
C.同步
D.異步
A.00
B.01
C.10
D.無(wú)法確定
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A.三態(tài)門(mén)
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C.OC門(mén)
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TTL與非門(mén)輸出低電平的參數(shù)規(guī)范值是()
一個(gè)兩輸入端的門(mén)電路,當(dāng)輸入為10時(shí),輸出不是1的門(mén)電路為()
TTL與非門(mén)閾值電壓UT的典型值是()
判斷如下VHDL的操作是否正確,如不正確,請(qǐng)改正。字符a和b的數(shù)據(jù)類(lèi)型是BIT,c是INTEGER,執(zhí)行c<=a+b。
如果把D觸發(fā)器的輸出Q反饋連接到輸入D,則輸出Q的脈沖波形的頻率為CP脈沖頻率f的()。
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要使JK觸發(fā)器的輸出Q從1就成0,它的輸入信號(hào)JK就為()。
兩個(gè)與非門(mén)構(gòu)成的基本RS觸發(fā)器,當(dāng)Q=1、Q=0時(shí),兩個(gè)輸入信號(hào)R=1和S=1。觸發(fā)器的輸出Q會(huì)()。
DRAM4164有2根片選線(xiàn)(RAS和CAS)、8根地址線(xiàn)和1根數(shù)據(jù)線(xiàn)。請(qǐng)判斷它的存儲(chǔ)容量為多少?
具有“有1出0、全0出1”功能的邏輯門(mén)是()