已知以下數(shù)據(jù)段:
DATA SEGMENT
VAR1 DB 10 dup(2, 3 dup())
VAR2 DW VAR3, VAR1, 10h
VAR3 DB 10, , 12 dup()
DATA ENDS
數(shù)據(jù)段DATA中定義的三個變量共占用()字節(jié)空間。
A.68
B.58
C.78
D.57
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A.14
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D.17
A.中斷請求寄存器IRR
B.中斷屏蔽寄存器IMR
C.中斷服務(wù)寄存器ISR
D.標(biāo)志寄存器EFLAGS
A.MOV CS,1000
B.OUT DX,AX
C.MOV BL,BP
D.MOV AH,DX
最新試題
在查詢式輸出接口典型電路中,數(shù)據(jù)端口地址和狀態(tài)端口地址可以是相同地址。()
ROL、ROR、RCL或RCR指令中的目的操作數(shù)可以是8/16位的寄存器或存儲器。()
在嵌入式應(yīng)用系統(tǒng)中,模擬I2C時序擴(kuò)展比硬件I2C通信擴(kuò)展具有更大的靈活性。
STM32的I2C接口最多有()個,在快速模式下,最高通訊速度可達(dá)()。
指令A(yù)DD AL,6[BP][DI]是錯誤的。()
STM32的I2C總線開啟一次后可以連續(xù)傳輸任意字節(jié)的數(shù)據(jù),而無需發(fā)送設(shè)備的地址號。
假設(shè)在增計數(shù)模式下的計數(shù)時鐘為12MHz,定時1s如何實現(xiàn)()。
某存儲器系統(tǒng)要求采用3:8譯碼器對A19~A15進(jìn)行全譯碼,需要()片。
MSP430單片機(jī)的ADC12轉(zhuǎn)換結(jié)果緩沖的寄存器有()個。
要組成32M×8bit的存儲器,需要1M×4bit的存儲芯片共()片。