A.階碼部件可實現(xiàn)加、減、乘、除四種運算
B.階碼部件只進行階碼相加、相減和比較操作
C.階碼部件只進行階碼相加、相減操作
D.尾數(shù)部件只進行乘法和除法運算
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A.一個以上,與非門
B.一個,三態(tài)緩沖器
C.n個,三態(tài)緩沖器
D.n個以上,或非門
A.非晶硅
B.單晶硅
C.多晶硅
D.硫化鎘
最新試題
設(shè)計8位字長的寄存器—寄存器型指令3條,16位字長的寄存器一存儲器型變址尋址方式指令4條,變址范圍不小于正、負(fù)127。請設(shè)計指令格式,并給出指令各字段的長度和操作碼的編碼。
為了使存儲系統(tǒng)的訪問效率從0.5提高到0.94,塊的大小至少增加到幾個字?
在編號分別為0,1,2,……,9的16個處理器之間,要求按下列配對通信:(B、1),(8、2),(7、D),(6、C),(E、4),(A、0),(9、3),(5、F)。試選擇所用互連網(wǎng)絡(luò)類型、控制方式,并畫出該互連網(wǎng)絡(luò)的拓?fù)浣Y(jié)構(gòu)和各級的交換開關(guān)狀態(tài)圖。
至少要分配給該程序多少個主存頁面才能獲得最高的命中率?
設(shè)16個處理器編號分別為0,1,…,15,要用單級互連網(wǎng)絡(luò),當(dāng)互連函數(shù)分別為:(1)Cube3(Cube1)(5)Butterfly(Butterfly)(8)σ-1(9)β(1)(13)ρ(2)時,第13號處理器分別與哪一個處理器相連?
如果一條指令的執(zhí)行過程分解為“取指令”和“分析”兩個階段,并采用兩級流水線。為了采用指令取消技術(shù),請修改上面的程序。
求出流水線的最優(yōu)調(diào)度策略及最小平均延遲時間和流水線的最大吞吐率。
寫出主存地址和Cache地址的格式,并標(biāo)出各字段的長度。
若采用FIFO替換算法,計算Cache的塊命中率。
寫出N=8的蝶式置換的互連函數(shù),如采用Omega網(wǎng)絡(luò),則需幾次通過才能完成此變換?畫出Omega網(wǎng)絡(luò)實現(xiàn)此變換的控制狀態(tài)圖。