下列指令序列用來對兩個數(shù)組進(jìn)行處理，并產(chǎn)生結(jié)果存放在$v0中。假定每個數(shù)組有2500個字，其數(shù)組下標(biāo)為0到2499。兩個數(shù)組的基地址分別存放在$a0和$a1中，數(shù)組長度分別存放在$a2和$a3中。要求為以下MIPS指令序列加注釋，并簡單說明該過程的功能。假定該指令序列運(yùn)行在一個時鐘頻率為2GHz的處理器上，add、addi和sll指令的CPI為1；lw和bne指令的CPI為2，則最壞情況下運(yùn)行所需時間是多少秒？
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若采用FIFO替換算法，計算Cache的塊命中率。
若在程序執(zhí)行過程中，每從主存裝入一塊到Cache，平均要對這個塊訪問16次，計算在這種情況下的Cache命中率。
一臺機(jī)器要求浮點(diǎn)數(shù)的字長的精度不低于10-7.2，表數(shù)的范圍正數(shù)不小于1038，且正負(fù)對稱。尾數(shù)用原碼、純小數(shù)表示，階碼用移碼、整數(shù)表示。設(shè)計這種浮點(diǎn)數(shù)的格式。
指出訪存操作數(shù)地址尋址的最大相對位移量為多少個字節(jié)？
畫出其中一組的邏輯圖。
僅根據(jù)使用頻度，不考慮其它要求，設(shè)計出全Huffman操作碼，計算其平均碼長。
如果把一條指令的執(zhí)行過程分解為“取指令”、“分析”（包括譯碼和取操作數(shù)等）和“執(zhí)行”（包括運(yùn)算和寫回結(jié)果等）三個階段，并采用三級流水線。仍然要采用指令取消技術(shù)，請修改上面的程序。
為了使存儲系統(tǒng)的訪問效率從0.5提高到0.94，塊的大小至少增加到幾個字？
有一個16KB4路組相聯(lián)Cache的32位微處理器，假定該Cache的塊為4個32位的字。主存地址為ABCDE8F8的單元在Cache中的什么位置。
考慮題目全部要求，設(shè)計優(yōu)化實(shí)用的操作碼形式，并計算其操作碼的平均碼長。